DESIGN WAVE MAGAZINE
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No.18
(1998年11月号)
表紙
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特集
116K システムASIC攻略ハンドブック
62K 第1章 ASICサインオフの過去・現在・未来
微細化と自動化を両輪として走り続けた20年
pp.20-24
49K Appendix ASICベンダ各社のライブラリ・サポート状況
pp.25-27
90K 第2章 静的タイミング解析ツールの攻略法
扱える回路の制約を設計の初期段階から意識しよう
pp.28-34
38K 第3章 サイクル・ベース・シミュレータの攻略法
初心者がはまりやすい六つの罠に要注意
pp.35-41
41K 第4章 フォーマル・ベリファイアの攻略法
課題も多いが効果も絶大,小さな回路から始めよう
pp.42-48
41K 第5章 フロアプランとレイアウトの攻略法
警告! 「信号遅延」,「信号の完全性」に由来するトラブルが急増中
pp.49-53
167K 第6章 IPの攻略法
とらえどころのないIPの実態を冷静に見つめよう
pp.54-57
92K 第7章 次世代の設計戦略
レイアウトに手を出しますか? RTLサインオフを要求しますか?
pp.58-69
ビギナーズ・スクエア
333K 続・RTLって何? -記述できること,できないこと
実践的VHDL設計セミナ(2)
pp.138-146
128K 遅延のあれこれ
HDL設計ステップアップ講座(VDHL編)(3)
pp.147-152
連載
231K アナログ系の相軌道の解析
数値計算ソフトウェアを用いたアルゴリズム検証(2)
pp.78-82
203K リコンフィギャラブル設計の実際
PLDを使った設計テクニック(3)
pp.83-96
260K ウェアラブル・コミュニケーション・ツールはこうして作った
次世代携帯機器開発のヒント(1)
pp.97-106
一般
313K EDAライセンスを有効活用してシステム費用を節約する方法
ワークロード管理の基礎知識
pp.70-77
46K 市販IPの購入には細心の注意が必要,やけどをするまえに厳しくチェック
動向レポート
pp.107-110
361K HDLシミュレーションを補完するコード・カバレージ技術
検証作業の進捗状況を定量的に分析
pp.131-137
19K FPGA/PLDのオンチップ・メモリを利用する方法
DWシリーズ・ユーザのためのサポート情報
p.153
コラム
26K ツール供給から設計改革支援にシフトするEDA業界
技術論評
p.111
26K 独自技術を持たない企業は生き残れない
ディジタル化の波に乗り遅れて三田工業が倒産
p.130
イベント・レポート
382K Hot Chips 10報告
pp.112-113
CD-ROM収録プログラム・データ
  Synplify v5.0.6(期間限定版)
FPGA/PLD用論理合成ツール
 
  PLS-WEB(MAX+plus II)9.01
PLD開発ツール
 
  DAI Coverscan/Statescan 3.0(機能限定版)
検証カバレージ・ツール
 
  ModelSim PE v4.7h(期間限定版)
VHDL/Verilog-HDL/混在HDL対応シミュレータ
 
  Electronics Workbench 4.1 Pro/Engineer's Pack(期間限定正規版)
アナログ/ディジタル回路図エディタ/シミュレータ
 
  WaveFormer Pro 4.5(規模限定版)
Verilog-HDLシミュレータ付き波形エディタ
 
  PeakSuite 4.2(期間限定版)
VHDLシミュレータ&FPGA/PLD用論理合成ツール
 
  StateCAD/StateSIM 4.11(期間限定版)
状態遷移図入力HDL生成ツール&シミュレータ
 
  半導体データ・ライブラリ
 
  イベント・フォト・ライブラリ
Internet World Tokyo,IBM総合フェア'98,第36回アミューズメントマシンショー,ハムフェア'98
 
  本誌記事関連データ
 

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